FC2カウンター FPGAの部屋 2010年05月08日
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FPGAやCPLDの話題やFPGA用のツールの話題などです。 マニアックです。 日記も書きます。

FPGAの部屋

FPGAの部屋の有用と思われるコンテンツのまとめサイトを作りました。Xilinx ISEの初心者の方には、FPGAリテラシーおよびチュートリアルのページをお勧めいたします。

Virtex-6 ファミリ デザイン セミナとSpartan-6 ファミリ デザイン セミナ

5月13日と14日に大崎のザイリンクス トレーニングセンターで行われるVirtex-6 ファミリ デザイン セミナに参加します。また、5月25日と26日に同様に大崎のザイリンクス トレーニングセンターで行われるSpartan-6 ファミリ デザイン セミナに参加します。参加される方、よろしくお願いします。

どこかおすすめのお昼のお店があったら、教えて下さい。よろしくお願いします。
  1. 2010年05月08日 21:41 |
  2. その他のFPGAの話題
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KiCad-2010-05-05

KiCad-2010-05-05-BZR2356-final-WinXP_full_with_components_doc_autoinstall.exeが出ています。最近アップデートが頻繁ですね。インストールして起動してみたのですが、どこが違っているかよくわかりません?
  1. 2010年05月08日 05:16 |
  2. CADツール
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ISE12.1の疑問

ISE12.1の疑問に思うことについて列挙します。

1. プロジェクトにソースファイルをAdd Sourceする時に1つのソースファイルしか選べないのはなぜでしょう? SHIFT+クリックやCTRL+クリックで複数選択出来ません。とても面倒です。(これはWindows7にインストールしたためかもしれません。対応OSでないのでしょうがないかも?)
(2010/05/10:追記) Windows7でCOMOD Internet Security 4.0 のSandbox で動作させていたためでした。SandboxをDisableしたところ、複数選択することができました。

2. UCFファイルをプロジェクトに入れたのに認識されない。Hierarchy表示で出てこない(図1)。Files表示ではプロジェクトに入っている(図2)。どうやらNew Project...で作ったときのよう?既存のプロジェクトを変換すれば大丈夫そう。これはWindows7でもWindows XPでも現象が出る。インプリメントしてもUCFの内容が反映されない。なかったことになっているようだ。
ISE121_question_1_100508.png
図1 Hierarchy表示

ISE121_question_2_100508.png
図2 Files表示

(2010/05/08:追記)どうやら、トップのDDR2_burst_test.vの以前のバージョンのファイルDDR2_burst_test_org.vを同時に入れてしまったのが原因のようでした。UCFは表示されるようになりました。ただ、PlanAheadを立ち上げて、配置制約を編集しようとしたら、エラーがでました。プロジェクトを作ったときにAddするUCFが古いものでhした。ISE11.5と同じUCFを使用したらエラーはなくなりました。

3. 2.のプロジェクトをProjectメニューのForce Hierarchy Reparseをしたら階層がおかしくなってしまった。どうしてだろうか?図3参照
ISE121_question_3_100508.png
図3 Force Hierarchy Reparse後のHierarchy表示

(2010/05/08:追記)どうやら、トップのDDR2_burst_test.vの以前のバージョンのファイルDDR2_burst_test_org.vを同時に入れてしまったのが原因のようでした。ProjectメニューのForce Hierarchy Reparseをしても階層は崩れませんが、パーサーエラーが2つ出ています。Cannot open include file "./ddr2_cont_parameters.vh"です。一応、プロジェクトにddr2_cont_parameters.vhは入っています。UCFのエラーの解析を先にすることにして、こちらは、もう少し様子をみます。
論理合成とインプリメントも通りました。パーサーエラーは出ますが、今のところ問題ないようです。

SP1を待つことにしようと思う
  1. 2010年05月08日 05:12 |
  2. Xilinx ISEについて
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