FC2カウンター FPGAの部屋 2012年09月07日
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WebPACK14.2でZedBoardのPS & PLチュートリアルをやってみた2(IPの追加)

WebPACK14.2でZedBoardのPS & PLチュートリアルをやってみた1(XPSプロジェクトの生成)”の続き。

今回は AXI General Purpose IO、AXI Timer/Counter、ChipScope AXI Monitor、ChipScope Integrated Controller をXPSプロジェクトに追加する。

33.左のIP Catalog のGeneral Purpose IOを展開して AXI General Purpose IOをダブルクリックした。
ZedBoard_PSPL_5_120907.png

34.ダイアログが出るのでOKボタンをクリックした。
ZedBoard_PSPL_6_120907.png

35.axi_gpio_0 の設定ダイアログが開く。UserタブのChannel 1 を開き、GPIO Data Channel Width を 32 から 1 に変更した。
ZedBoard_PSPL_7_120907.png

36.どこのAXIバスに接続するか?設定するダイアログが出てくる。デフォルトのprocessing_system7_0 を確認してOKボタンをクリックした。
ZedBoard_PSPL_8_120907.png

37.axi_gpio_0 がXPSに表示された。
ZedBoard_PSPL_9_120907.png

38.左のIP Catalog のDMA and Timer を展開して AXI Timer/Counter をダブルクリックした。
ZedBoard_PSPL_10_120907.png

39.ダイアログが出るのでOKボタンをクリックした。
ZedBoard_PSPL_11_120907.png

40.axi_timer_0 のの設定ダイアログが開く。デフォルト値のままOKボタンをクリックした。
ZedBoard_PSPL_12_120907.png

41.どこのAXIバスに接続するか?設定するダイアログが出てくる。デフォルトのprocessing_system7_0 を確認して、OKボタンをクリックした。
ZedBoard_PSPL_13_120907.png

42.axi_timer_0 がXPSに表示された。
ZedBoard_PSPL_14_120907.png

これらのIPはPSのCentral Interconnect に接続されている32b GP AXI Master Port のM_AXI_GP0 に接続されている。
ZedBoard_PSPL_15_120907.png

ZedBoard_PSPL_16_120907.png


43.左のIP Catalog のDebug を展開して、ChipScope AXI Monitor をダブルクリックした。
ZedBoard_PSPL_17_120907.png

44.ダイアログが出るのでOKボタンをクリックした。
ZedBoard_PSPL_18_120907.png

45.chipscope_axi_monitor_0 の設定ダイアログが開く。デフォルト値のままOKボタンをクリックした。
ZedBoard_PSPL_19_120907.png

46.chipscope_axi_monitor_0 がXPSに表示された。
ZedBoard_PSPL_20_120907.png

47.先ほど同様、左のIP Catalog のDebugからChipScope Integrated Controller をダブルクリックした。
ZedBoard_PSPL_21_120907.png

48.ダイアログが出るのでOKボタンをクリックした。
ZedBoard_PSPL_22_120907.png

49.chipscope_icon_0 の設定ダイアログが開く。デフォルト値のままOKボタンをクリックした。
ZedBoard_PSPL_23_120907.png

50.chipscope_icon_0 がXPSに表示された。
ZedBoard_PSPL_24_120907.png

これで、axi_interconnect_1, axi_gpio_0, axi_timer_0, chipscope_axi_monitor_0, chipscope_icon_0がXPSに入った。

WebPACK14.2でZedBoardのPS & PLチュートリアルをやってみた3(IPの設定)”に続く。

  1. 2012年09月07日 05:34 |
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