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AXI4 プロトコルの勉強1

XilinxのEDKはAXI4バスを使用することが出来る。今回はカスタム AXI Master IP コアの作成を目指そうと思う。AXI4 Masterコアを作成できるようにAXIプロトコルについて学んで行くつもりだ。

参考資料を以下に示す。
AXI リファレンスガイド UG761 (v13.2)2011年7月6日
12.3 EDK、12.3 ISE - カスタム AXI IP コアの作成方法
AMBA_AXI_プロトコルV1.0_SpecJ.pdf(ARM社からダウンロード)
IHI0022D_amba_axi_protocol_spec.pdf(ARM社からダウンロード)

AXI4インターフェースの種類
1.AXI4    : メモリマップ式のバースト可能インターフェース。最大256バースト。
2.AXI4-Lite : メモリマップ式の単一トランザクションのインターフェース。バーストできない。
3.AXI4-Steam: アドレスフェーズがないデータ・バースト・サイズに制限がないプロトコル。ストリーム用

AXI4とAXI4-Liteは5つのチャネルから構成される。
1.読み出しアドレスチャネル (Read address channel) 
2.書き込みアドレスチャネル (Write address channel)
3.読み出しデータチャネル (Read data channel)
4.書き込みデータチャネル (Write data channel)
5.書きこみ応答チャネル (Write response channel)
  1. 2011年12月07日 05:56 |
  2. AXI4バス
  3. | トラックバック:0
  4. | コメント:3

コメント

こんにちは。

AXI4のペリフェラルを作成しようとしていた所に素晴らしいタイミングでこの書き込みを読みました。

「AMBA_AXI_プロトコルV1.0_SpecJ.pdf」は日本語の資料だと思うのですが、
ARM社のサイトを検索しても出てきません。
検索のキーを教えて頂けませんか?
  1. 2011/12/08(木) 13:36:25 |
  2. URL |
  3. まさ #-
  4. [ 編集 ]

まささん、こんにちは。

残念ながら、日本語の資料はもう無いようです。以前ダウンロードしたときはあったんですが。。。
  1. 2011/12/08(木) 14:00:01 |
  2. URL |
  3. marsee #f1oWVgn2
  4. [ 編集 ]

それは残念です。
XILINXが提供している日本語の資料で概要を掴んでから本家の資料を見る作戦で行こうと思います。
ありがとうございました。
  1. 2011/12/09(金) 14:48:42 |
  2. URL |
  3. まさ #-
  4. [ 編集 ]

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