FC2カウンター FPGAの部屋 ZedBoardでHDMI出力9(ADV7511のレジスタ設定3)
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ZedBoardでHDMI出力9(ADV7511のレジスタ設定3)

何か、飽きてきたのですが、途中でやめられないので続けます。

0xd0番地 -> 0x3c
[7] -> Enable DDR Negative Edge CLK Delay => 0 = Disable DDR Negative Edge CLK Delay , 1 = Enable DDR Negative Edge CLK Delay
[6:4] -> DDR Negative Edge CLK Delay => 000 = -1200 ps , 001 = -800 ps , 010 = -400 ps , 011 = no delay , 100 = 400 ps , 101 = 800 ps , 110 = 1200 ps , 111 = Invert CLK
[3:2] -> Sync Pulse Select 00 = DE , 01 = Hsync , 10 = Vsync , 11 = no sync pulse
[1] -> Timing Generation Sequence => 0 = sync adjustment then DE generation , 1 = DE generation then sync adjustment
[0] -> Fixed => Must be set to Default Value

0xd1番地 -> 0xff
[7:0] -> Fixed => Must be set to Default Value

0xde番地 -> 0x9c
[7:4] -> Fixed => Must be set to Default Value (1001)
[3] -> TMDS Clock Inversion 0 = Normal TMDS Clock , 1 = Inverted TMDS Clock
[2:0] -> Fixed => Must be set to Default Value (100)

0xe0番地 -> 0xd0
[7:0] -> Fixed => Must be set to 0xD0 for proper operation

0xe4番地 -> 0x60
[7:0] -> Fixed => Must be set to Default Value

0xf9番地 -> 0x00
[7:0] -> Fixed I2C Address => This should be set to a non-conflicting I2C address (0x00)

0xfa番地 -> 0x00
[7:5] -> Hsync Placement MSB (Embedded Sync Decoding) => 000
[4:2] -> Hsync Placement MSB (Sync Adjustment) => (000)

0x17番地 -> 0x02
[7] -> Fixed => Must be set to Default Value (0)
[6] -> Vsync Polarity => (Case 2:Sync Adjustment Register (0x41[1]) = 0) 0 = sync polarity pass through, High polarity , 1 = sync polarity invert, Low polarity
[5] -> Hsync Polarity => (Case 2:Sync Adjustment Register (0x41[1]) = 0) 0 = sync polarity pass through, High polarity , 1 = sync polarity invert, Low polarity
[4:3] -> Reserved @ 00b => Must be set to Default Value
[2] -> 4:2:2 to 4:4:4 Interpolation Style => 0 = use zero order interpolation , 1 = use first order interpolation
[1] -> Aspect Ratio => 0 = 4:3 Aspect Ratio , 1 = 16:9 Aspect Ratio
[0] -> DE Generator Enable => 0 = Disabled , 1 = Enabled
  1. 2012年11月15日 04:43 |
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