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FPGAから他のデバイスへクロック供給

FPGAから出力するクロックの位相FPGAから出力するクロックの位相2FPGA出力クロックの解析でFPGAから他のデバイスへクロック供給について考察?(そんな良いもんじゃないという話もあるが)したが、結局外部フィードバックをするとDCMへのクロック入力遅延とフィードバック入力遅延が合わずにFPGA外部に出力するクロックの位相が入力クロックと合わずに困ることがあった。
やはり外部フィードバックはやめて内部フィードバックで行くことにした。これだと遅延が計算できる。ディフォルトだとクロックパスは遅延をキャンセルするように自動調整されるので出力用DDRレジスタと出力パッドの遅延分だけキャンセルすればよいようだ。実際に計算して設定してみたら動作した。
あまり関心はないかもしれないが、またレポートしようと思う。
  1. 2006年09月13日 21:29 |
  2. FPGAからクロック出力
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