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Altium Designer でC to Hardware のサンプルを試してみる2

Altium Designer でC to Hardware のサンプルを試してみる1”の続き。

まずは、C-to-Hardware Compiler User Manual があった。よく書いてあるようだ。

次に、Altium Designer でC to Hardware のサンプルを試してみる1のシミュレーション波形だが、1つの累算が終わってから、次の累算のstart を入れていたが、done しないうちにstart を入れたらどうだろう?と思ってテストベンチを変更してやってみた。
Altium_Designer_C2H_11_120427.png

パイプラインにはなっていないようだ。必ずdone が上がってからstart 信号を入れる必要があるようだ。ちなみに下の波形が前回のシミュレーション波形だ。
Altium_Designer_C2H_10_120426.png

表示メニューからデバイスビューを表示して、FPGAのCompile を開き、Generate HDL for ... のりポートファイルを開く。
Altium_Designer_C2H_12_120427.png

下にリポートファイルを開いた様子を示す。
Altium_Designer_C2H_13_120427.png

リポートファイルに下のような記述があった。引用する。

* Accumulate
============
+------------------------------------------------------------------------------------------------+
| calling convention | parallel multi cycle, entry point, register outputs, start on rising edge |
| states | 4 |
| registers | 64 bits |
| clock cycles | 3 |
| ALU | 32 |
+------------------------------------------------------------------------------------------------+


やはりクロックサイクルは3だそうだ。

・次に、トップの回路図でCモジュール、U_Accumulate をダブルクリックする。
Altium_Designer_C2H_17_120427.png

・C コード シンボル・ダイアログが開く。
Altium_Designer_C2H_14_120427.png

・エントリ・タブをクリックする。インターフェースタイプは現在は、Parallel Multi-cycle になっているが、Parallel Combinatorial なども選択することが出来る。Wishbone のインターフェースでやり取りできるモードもあった。
Altium_Designer_C2H_15_120427.png

・インターフェースタイプをParallel Combinatorialにした。
Altium_Designer_C2H_16_120427.png

・以前の図と比べると、CLOCK、RESET、DONE、RESET_DONE が無くなったことがわかる。
Altium_Designer_C2H_18_120427.png

・コンパイルしたところ、Generate HDL for ...でエラーが出てしまった。
Altium_Designer_C2H_19_120427.png

・上で表示されているエラーをダブルクリックするとCソースに飛んでいった。
Altium_Designer_C2H_20_120427.png

あ、そうか。もしかして?累算しているから順序回路にするしか方法が無いのか。。。組み合わせ回路にするのは諦めることにする。レイテンシを変える方法がまだ見つからない。レイテンシを変えてみたいのだが。。。
もしかして、制約ファイルの動作周波数を変えるとレイテンシが変わるのか?
  1. 2012年04月27日 05:51 |
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