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PlanAhead14.1のExampleのBFT Core を試してみた3(Implementation編)

PlanAhead14.1のExampleのBFT Core を試してみた2(Synthesis編)”の続き。

今回は、Implementationを行った。

・Implementation -> Run Implementation をクリックした。

・Implementation が成功したというダイアログが表示されたが、誤って消してしまった。デザインを表示させる場合は、FlowメニューからOpen Implemented Design -> を選択する。
PlanAhead141_42_120514.png

・Implementation -> Implemented Design -> Edi Timing Constrains は、Synthesisの時と変わりが無いので省略。

・Implementation -> Implemented Design -> Run TRCEをクリックした。Run TRCE ダイアログが表示された。OKボタンをクリックした。
PlanAhead141_43_120514.png

・Timing TRCE結果が下のウインドウに表示された。
PlanAhead141_44_120514.png

・Implementation -> Implemented Design -> Report Clock Interaction もSynthesisの時と変わりが無いので省略。

・Implementation -> Implemented Design -> Run DRC もSynthesisの時と変わりが無いので省略。

・Implementation -> Implemented Design -> Report Noise もSynthesisの時と変わりが無いので省略。

・Implementation -> Implemented Design -> Report Utilization もSynthesisの時と変わりが無いので省略。

・Implementation -> Implemented Design -> XPower Analyzer をクリックした。Launch XPower Analyzerダイアログが表示された。何も指定せずに、OKボタンをクリックした。
PlanAhead141_45_120514.png

・XPower Analyzer が立ち上がって、消費電力の計算結果を表示した。
PlanAhead141_46_120514.png

・Implementation -> Implemented Design -> FPGA Editor をクリックした。FPGA Editorが起動した。
PlanAhead141_47_120514.png

・Implementation -> Implemented Design -> Run Timing Simulation をクリックした。Launch Timing Simulationダイアログが表示された。Launchボタンをクリックした。
PlanAhead141_48_120514.png

・ISimが立ち上がり、タイミング・シミュレーション結果が表示された。(タイミング・シミュレーションは時間がかかるので、余りやらない。論理シミュレーションと静的タイミング解析で終わりにしてしまう)
PlanAhead141_49_120514.png

  1. 2012年05月14日 05:16 |
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