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LUT使用率97%

昨日は実験だったのだが、今度の実験の担当の先生と話しているとFPGAの話になった。
その先生はとにかく速度やFPGAのリソース使用率を上げるためにLUT(Look Up Table)を常に意識したVerilogの記述をしているそうだ。FPGA内のローカル配線やグローバル配線なども意識してVerilogを書いているそうだ。LUTの使用率97%ぐらいはいけるとのことだった。98%にしようとすると失敗するといっていた。凄いびっくり。
組み合わせ回路もalways文やfunction文など使わないでLUTを意識した論理記号で書いているようだった。究極のスピードとLUT使用率を実現するために。
凄すぎてちょっと私にはついていけない感じ。デバイス専用のHDL記述になってしまうのでIPとして再利用は出来なくなる。
性能を追求するためにここまでしているのかと感心した。
  1. 2006年12月05日 05:31 |
  2. その他のFPGAの話題
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コメント

LUT使用率

LUTというよりもSLICEで98%ぐらいいった事があります.
V2P40だったかな.
だた,私の場合何も考えずに書いていたら結果そうなっただけですが,,,
  1. 2006/12/05(火) 18:36:50 |
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  3. けむり #-
  4. [ 編集 ]

こんにちは。
私もV2-1000でNumber of occupied Slicesは99%いったことありますが、Number of 4 input LUTsは83%くらいでした。Number of 4 input LUTsが97%ということだと思います。SLICEにはLUTが2つ入っていますが、そのうちの1つは結構空いている状態だと思います。

Logic Utilization:
Number of Slice Flip Flops: 4,351 out of 10,240 42%
Number of 4 input LUTs: 8,583 out of 10,240 83%
Logic Distribution:
Number of occupied Slices: 5,118 out of 5,120 99%
Number of Slices containing only related logic: 4,722 out of 5,118 92%
Number of Slices containing unrelated logic: 396 out of 5,118 7%
*See NOTES below for an explanation of the effects of unrelated logic
Total Number 4 input LUTs: 8,899 out of 10,240 86%
Number used as logic: 8,583
Number used as a route-thru: 283
Number used as Shift registers: 33

Number of bonded IOBs: 314 out of 324 96%
IOB Flip Flops: 143
IOB Dual-Data Rate Flops: 1
Number of Block RAMs: 34 out of 40 85%
Number of GCLKs: 4 out of 16 25%
Number of DCMs: 2 out of 8 25%
  1. 2006/12/05(火) 18:57:25 |
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  3. marsee #-
  4. [ 編集 ]

そうですね

addnやaddpなどやってたXACT2の頃を思い出します。
少ないリソースでなんとかがんばろーなんてやってましたが
今はお任せモードになってます。
明日、あれ?今日かな幕張のセミコンに行きます。
  1. 2006/12/07(木) 23:56:33 |
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  3. けむり #-
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こんにちは。コメントありがとうございます。
幕張のSEMIJapanでしようか?ということは半導体関連ですか?
私も昨日はPSoCのセミナーに行きたかったのですが、骨折のため断念しました。来年の6月に行ってこようと思っています。現在のところ右足をかばいながら歩いているので歩きづらいです。
  1. 2006/12/08(金) 05:56:51 |
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  3. marsee #-
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