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FPGAやCPLDの話題やFPGA用のツールの話題などです。 マニアックです。 日記も書きます。

FPGAの部屋

FPGAの部屋の有用と思われるコンテンツのまとめサイトを作りました。Xilinx ISEの初心者の方には、FPGAリテラシーおよびチュートリアルのページをお勧めいたします。

Aurora

今月号のDWMにはAurora活用チュートリアルが載っていた。AuroraはXilinxのRocketIOを使った無料の通信用IPだ。
私も2年ほど前に評価したことがある。ModelSimで対向にしてシミュレーションしてVirtex2proに試しにインプリメントしてみた。対向にしてシミュレーションした時に入力してから反対側に出力するまでのレイテンシが思っていたよりも長かったような気がする。
確かやってみたのは4LaneでLane Widthは2だったので合計8バイト幅の入出力データ幅だったと思う。RocketIOの動作周波数は3.125GHz、8B10Bエンコードで1Lane当たり2.5Gbpsだったと思う。(2年前なので記憶があいまい)
ModelSimはSWIFTインターフェースを使えないといけないのでSEを使った。Xilinxのアンサー”ModelSim (SE、PE)、6.2i SmartModel/SWIFT インターフェイス - ModelSim で MGT および PPC の SmartModel を使用する方法”を見ながらModelSimの$MODEL_TECH ディレクトリの modelsim.iniファイルを修正してシミュレーションすることが出来た。(結局Auroraは使っていないけど。。。懐かしい)
  1. 2006年12月11日 19:23 |
  2. その他のFPGAの話題
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  4. | コメント:6

コメント

レンテンシ

はじめまして。
上記の文中、
1。今月のDWMは、Design Wave Magazine, 2007 Janのことでしょうか。取り寄せましたが、マニュアルに記述されていないことも書いてありますね。その他に、なにか良い雑誌はございませんでしょうか。
2。レイテンシは、具体的にどの程度でしたか?思ったよりというのは、どの程度を当初想定されていましたか?よかったら教えてください。

では。
  1. 2008/02/12(火) 13:50:23 |
  2. URL |
  3. jerk #-
  4. [ 編集 ]

jerkさん、はじめまして。
1.Auroraが載っている雑誌ということですよね? あまりないと思います。
2.レイテンシの実際の値は数百nsだったと思います。TXからRXにデータが出てくるまでの時間。もっと速いと思っていました。
  1. 2008/02/12(火) 14:03:07 |
  2. URL |
  3. marsee #-
  4. [ 編集 ]

Auroraのビット順は?

はじめまして、どうしてもascendingの意味が解らず悩んでいたところ、このページを見つけました。よろしくお願い致します。

XilinxのAurora資料 (LogiCORE IP Aurora v3.0 UG061 (v3.0) )
P29を見ると、TX_D[0:(8n-1)] 、RX_D[0:(8n-1)] となっており
説明には、Ascending bit orderと書かれています。
一方、Figure3.3では、bit0=MSBであり、MSBから順に送られるように書かれていて、次のように説明されています。

Aurora cores use ascending ordering. They transmit and receive the most significant bit of the most significant byte first.

自分の理解では、Ascending bit orderなら、LSBから順に送られなくてはならないように思えるのですが、何か、考え違いがあるのでしょうか?
  1. 2013/03/29(金) 02:41:09 |
  2. URL |
  3. Atom #xm7FiIss
  4. [ 編集 ]

もうAuroraは遠い昔に試しにやっただけで忘れました。シミュレーション結果も残っていません。
ですが、AuroraはIBMのPowerPCが入っていた時代のFPGAからのIPだったと思います。つまり、ビット0がMSBの仕様です。
MSBから出ると言っているので、ビット0、ビット1、ビット2 じゃないんでしょうか?昇順ですよね?
あくまで推測ということをお断りしておきます。それに、Xilinxのライセンスを承認しているので、この辺りは公開されたWeb上で返答が難しい所でもあります。そういう理由で、わざと詳しく記録は残していません。代理店のFAEに相談されることをお勧めします。
  1. 2013/03/29(金) 03:41:42 |
  2. URL |
  3. marsee #f1oWVgn2
  4. [ 編集 ]

ありがとうございます。
ascending bit orderというのは、てっきり、『bit重み』が昇順になっている事を意味しているんだろうと考えていましたが、『bit番号』が昇順になっているという意味に解釈するのであれば、確かに、他の説明とも辻褄があいます。合点致しました。
とにかく、『ascending order』という説明だけでだまされず、図の方でしっかり確認しておかなければ駄目だという事がよく解りました。
代理店さんに問い合わせるべきだとは思いますが、以前、別の問題で、さんざん頓珍漢で高飛車な『アドバイス』を受けて遠回りしてしまった経験があり、いまいち信用する気になれないんです(Tえれ)。結局自分でXilinx IPのバグを発見し解決致しましたが。

  1. 2013/03/29(金) 10:08:05 |
  2. URL |
  3. Atom #xm7FiIss
  4. [ 編集 ]

良かったです。それで合っていると思うのですが。。。

> 代理店さんに問い合わせるべきだとは思いますが、以前、別の問題で、さんざん頓珍漢で高飛車な『アドバイス』を受けて遠回りしてしまった経験があり、いまいち信用する気になれないんです(Tえれ)。結局自分でXilinx IPのバグを発見し解決致しましたが。

そのIPを使い込んでいる方に当たればジャストの回答をくれると思いますが、やったことがないとアンサーを探して返事するという対応になりがちかもしれませんね?
  1. 2013/03/30(土) 08:26:01 |
  2. URL |
  3. marsee #f1oWVgn2
  4. [ 編集 ]

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