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Verilog2001版DDR SDRAMコントローラーのModelSimシミュレーション6

Verilog2001版DDR SDRAMコントローラーのModelSimシミュレーションは大体終了した。
いろいろどたばたがあったどうもうまく動かないと思ったら古いバージョンのVHDLを元にVerilog2001に直してしまった。新しいバージョンとWinMergeで比較しながらVerilogを修正した。バージョン管理が出来てない、反省。
これでシミュレーションは動いたと思ったのだが、実際にISEでインプリメントすると動かない。そうしたら今度はINSTROM.Vのバージョンが古かった。
もう一度インプリメントしてもまだリードデータが出てこない状況だ。もう一度見直してみたい。
  1. 2007年02月05日 06:05 |
  2. 入門Verilog
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