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ultra96v2-platform で lap_fitler_axis_dma を試してみる2(Vitis 2019.2 のカーネルコードはVitis 2020.1で使用できない)

ultra96v2-platform で lap_fitler_axis_dma を試してみる1(プロジェクトの作成とビルド)”の続き。

前回、Ultra96V2 用の Vitis アクセラレーション・プラットフォーム ultra96v2-platform を使用して、 lap_filter_axis_dma をビルドしたのだが、Vivado を立ち上げてブロックデザインを見ると、使用されていない AXI4-Lite インターフェースがあった。これは、”Vitis HLS 2020.1 と Vivado HLS 2019.2 の違い(AXI4 Master インターフェースでの offset=slave オプション時の扱いの違い)”で探った Vivado HLS と Vitis HLS の違いが原因のようだ。今回は、そこを修正してもう一度ビルドしよう。

まずは、Vivado プロジェクトを開く。
Assistant ウインドウの lap_filter_axis_dma_system -> lap_filter_axis_dma -> Hardware -> lap_filter_axis_dma を右クリックし右クリックメニューから Open Vivado Project を選択する。
Ultra96V2_acc_platform201_129_201024.png

Vivado のプロジェクトが開く。
Ultra96V2_acc_platform201_130_201024.png

ブロックデザインを確認する。
Ultra96V2_acc_platform201_131_201024.png

lap_filter_axis_dma_1 の s_axi_control_r ポートが空いている。
Ultra96V2_acc_platform201_132_201024.png

これは、”Vitis HLS 2020.1 と Vivado HLS 2019.2 の違い(AXI4 Master インターフェースでの offset=slave オプション時の扱いの違い)”が原因だろう?

lap_filter_axis_dma.cpp の lap_filter_axis_dma 関数に指示子を 2 個追加した。

#pragma HLS INTERFACE s_axilite port=inm bundle=control
#pragma HLS INTERFACE s_axilite port=outm bundle=control


Ultra96V2_acc_platform201_133_201024.png

再度、ビルドを行って成功した。
Ultra96V2_acc_platform201_134_201024.png

再度、Vivado のブロックデザインを見ると lap_filter_axis_dma_1 の s_axilite ポートは 1 つだけで、問題が解消した。
Ultra96V2_acc_platform201_135_201024.png

Assistant ウインドウの lap_filter_axis_dma_system -> lap_filter_axis_dma -> Hardware -> lap_filter_axis_dma -> lap_filter_axis_dma を右クリックし右クリックメニューから Open HLS Project を選択して VItis 2020.1 を起動する。
Ultra96V2_acc_platform201_125_201024.png

Launch Vitis HLS ダイアログが表示された。OK ボタンをクリックした。
Ultra96V2_acc_platform201_126_201024.png

Vitis HLS 2020.1 が表示された。
Ultra96V2_acc_platform201_136_201024.png
  1. 2020年10月24日 20:14 |
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