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メディアン・フィルタを含んだ Vitis アクセラレーション・プラットフォームを作成する2(Vivado で kv260_median_platform プロジェクトを作成2)

メディアン・フィルタを含んだ Vitis アクセラレーション・プラットフォームを作成する1(Vivado で kv260_median_platform プロジェクトを作成1)”の続き。

メディアン・フィルタ IP を使用した kv260_median_platform プロジェクトを Vivado 2021.1 で作成するということで、前回は、kv260_median_platform プロジェクトを作成し、system ブロック・デザインを紹介した。今回は、Platform Setup ウインドウの設定を紹介し、エミュレーション設定をして、論理合成、インプリメンテーション、ビットストリームの生成を行って成功した。

Platform Setup ウインドウの AXI Port の設定を紹介する。
zynq_ultra_ps_e_0 の M_AXI_HPM0_FPD と M_AXI_HPM1_FPD をイネーブルする。
Memport は M_AXI_GP で、 SP Tag は空とする。デフォルトのままとする。

zynq_ultra_ps_e_0 の以下の AXI インターフェースをイネーブルする。
S_AXI_HPC1_FPD, S_AXI_HP0_FPD, S_AXI_HP1_FPD, S_AXI_HP2_FPD, S_AXI_HP3_FPD

S_AXI_HPC0_FPD の Memport を S_AXI_HP に変更する。
SP Tag に HPC1, HP0, HP1, HP2, HP3 を入力する。
kv260_median_platform_17_220512.png

ps8_0_axi_periph の M03_AXI から M09_AXI までをイネーブルする。
Memport は M_AXI_GP で、 SP Tag は空とする。デフォルトのままとする。
kv260_median_platform_18_220512.png

Platform Setup ウインドウの Clock の設定を紹介する。
clk_out1, clk_out2, clk_out3 の Enable チェックボックスをクリックする。

IDを
clk_out1 を 0
clk_out2 を 1
clk_out3 を 2 に設定する。

clk_ou2 の Is Default ラジオボタンをクリックして選択する。

Info に”Info: No problem with Clock interface.”が表示されていることを確認する。
kv260_median_platform_19_220512.png

Platform Setup ウインドウの Interrupt の設定を紹介する。
axi_intc_0 の intr のチェックボックスにチェックを入れた。
kv260_median_platform_20_220512.png

Platform Setup ウインドウの Platform Name の設定はデフォルトのままとした。
kv260_median_platform_21_220512.png

エミュレーション設定(オプション)
Diagram ウインドウで zynq_ultra_ps_e_0 をクリックする。
SELECTED_SIM_MODEL を tlm に変更した。
kv260_median_platform_22_220512.png

論理合成、インプリメンテーション、ビットストリームの生成
Vivado 2022.1 の FLow Navigator で PROGRAM AND DEBUG の Generate Bitstream をクリックして論理合成、インプリメンテーション、ビットストリームの生成を行った。

途中で、/axi_intc_0/intr がつながっていないクリティカル・メッセージが出た。
kv260_median_platform_23_220512.png

ビットストリームの生成が成功した。
Project Summary を示す。
kv260_median_platform_24_220512.png
  1. 2022年05月14日 04:51 |
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