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Floorplan IO (複数の制約ファイル(UCF)を使った制約)

ISE10.1で複数の制約ファイル(UCF)を使えるということで、試してみた。現在やっているSuzaku-VのDDR2 SDRAMコントローラのインプリメントでUCFファイルを2つに分けてみた。それは、Suzaku_DDR2_test_ddr2.ucf と Suzaku_DDR2_test_dev.ucf だ。それぞれDDR2用のIOの制約とそれ以外のIOの制約に分けている。タイミング制約はSuzaku_DDR2_test_dev.ucf に入っている。
ISE_constraints_1_080601.png

これをProcessesペインからFloorplan IO - Pre-Synthesis を選択してFloorplan Editorを起動する。この辺のインターフェースはISE10.1から変更されている。大体、どんなことをするのかが予測がつく。
ISE_constraints_2_080601.png

起動すると下のような画面が出てくるが、すでにすべてのIOがアサインされているはずなのに、ddr2_clkとddr2_clkb が空になっている。
ISE_constraints_3_080601.png

これはddr2_clk と ddr2_clkb の宣言の仕方に問題があるようだ。パラメータに値が入ると下のように宣言される。

output [0 : 0] ddr2_clk;
output [0 : 0] ddr2_clkb;


要素数が1のバスになってしまう。UCFでの定義は下のようになっている。

NET "ddr2_clk<0>" LOC = "A16" ;
NET "ddr2_clkb<0>" LOC = "B16" ;


それでFloorplan Editorは同じものと認識できないようだ。
実際にインプリメントすると、ちゃんと制約で指定したIOにアサインされているので、ISE本体では大丈夫のようだ。ただ、Floorplan Editorでは表示できない。(今のところ、ISE10.1.01、こんな記述でいいのかどうかは別問題として。。。)
これを利用して、Floorplan Editor でIOをアサインして、どっちのUCFに制約がかかれるかやってみた。
Floorplan Editorでドラック&ドロップして、ddr2_clk と ddr2_clkb の出力IOを指定した。
ISE_constraints_4_080601.png

これでSaveしてみる。ちなみにSave As... はできないようだ。
そうすると、Suzaku_DDR2_test_ddr2.ucf に下のような制約が追加された。

NET "ddr2_clk" LOC = A16;
NET "ddr2_clkb" LOC = B16;
NET "ddr2_clk" IOSTANDARD = "SSTL18_I";
NET "ddr2_clkb" IOSTANDARD = "SSTL18_I";


ISE上で上のUCFにつかされるのだろうか?
とりあえず、制約を追加したままインプリメントしても、Translateでワーニングが出るだけで、他の問題はないようだ。

ところで、DQの最適な遅延値を測定するDDR2 SDRAMコントローラは結局失敗しましたが、誰か要りますか? もし試してくれる方がいらっしゃるのだったら載せようと思う。
  1. 2008年06月01日 18:56 |
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  4. | コメント:2

コメント

10.1

どうも10.1はEDKの使い勝手が今までと違うので9.2と行ったり来たりしてます。
てなわけで10.1は立ち上げ回数が減っています。
てか、FPGAを使う仕事が減っている、、、
致命傷です。
  1. 2008/06/01(日) 23:54:58 |
  2. URL |
  3. けむり #fo/KTNEA
  4. [ 編集 ]

けむりさん、 こんにちは。

本当にXilinxはツールが変化するのが早いですね。ついていくか、もとあるツールを使い続けるかですね。古いデバイスは古いツールで十分だろうと思います。と言いながら新しいツールに行ってしまうんですよね。
  1. 2008/06/02(月) 08:11:51 |
  2. URL |
  3. marsee #-
  4. [ 編集 ]

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